Trabajo sistemas digitales 1ra entrega
jose20042010Tarea9 de Abril de 2021
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INTRODUCCION
el proyecto de la materia de SISTEMAS DIGITALES Y ENSAMBLADORES es el desarrollo de una serie de ejercicios donde se pone en practica el conocimiento y el dearrollo de actividades durante el tiempo de la asignatura esto con el fin de incentivar el aprendidaje autonomo con gran relevancia en casos reales
OBJETIVO
Tener un panorama general de las ventajas y problemas en cuanto a diseño e implementación de sistemas digitales, con esto obtener el conocimiento teórico y práctico sobre diversas aplicaciones de la técnica digital para implementarlo en casos reales.
ACTIVIDAD SEMANA 3
Se desea diseñar el sistema de control de lectura y escritura de una memoria RAM de 32 filas x 32 columnas, donde cada dato es de 4 bits. Para la primera entrega deberá presentar una propuesta de diseño de tres circuitos combinables en Logisim
- Un decodificador que convierte una señal de 5 bits a un único dato (entre 0 y 31) para la selección de filas y columnas de una memoria RAM, y para el control de lectura/escritura de la misma.
SOLUCION
la matriz de 32 celdas que hace referencia 5 bits, el sistema binario solo
es 0 y 1, asi son las posibilidades que se obtienen como se evidencia en la siguiente figura
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32 | 16 | 8 | 4 | 2 | 1 |
asi mismo la matriz de operación sin datos, la columna marcada en color rojo corresponde al peso de cada bit[pic 14]
de esta manera obtendermos la tabla de verdad de la memoria de 0 a 31[pic 15]
posteriormente debemos tener encuenta el mapa de Karnaugh con la siguiente salida
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de esta manera se muestra la grafica sin datos, la letra A muestra la direccion de entrada y la D la direccion de salida, la sigla SEL activa la memoria para obtener datos, CLR es el control, el no resetea la informacion de la memoria OUT permite el ingreso y salida de datos de la memoria [pic 18]
En esta entrada de 5 bit contiene datos 0011 en posicion 7, en el sistema hexadecimal arroja 4 bit de salida, para el nuemro 7 el resultado en binario es 111
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32 | 16 | 8 | 4 | 2 | 1 |
Datos de entrada | 1 | 1 |
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CIRCUITO DE 3 ENTRADAS Y DOS SALIDAS
Cuando CS y WE estan activados, la salida E debe activarse[pic 26]
Si WE está activado, la salida L debe permanecer inactiva
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Si CS y OE están activados, la salida L debe activarse
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con esta grafica podemos evidenciar la tabla de la verdad de los circuitos anteriores
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con estas grafica podemos evidenciar los mapas de Kamaugh para la elaboracion de los circuitos anteriores.
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